Verilog HDL 快速入门1：基本概况、结构和数据类型

其他 2020-09-21 11:42:39 阅读次数: 0

目录

一、术语和概况简介

二、Verilog语法

1、程序的基本结构

2、模块与端口的声明

3、数据类型

4、数值表示

5、模块例化（调用）

一、术语和概况简介

RTL的综合与仿真概述：

二、Verilog语法

1、程序的基本结构

module 模块名（端口列表）;

端口的声明（包含输入、输出、变量等）

本模块变量、信号的声明

电路功能的实际描述

时序参数

endmodule

示例程序：

2、模块与端口的声明

3、数据类型

4、数值表示

5、模块例化（调用）

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