(1)时序电路建模时，用非阻塞赋值。
(2)锁存器电路建模时，用非阻塞赋值。
(3)用always块建立组合逻辑模型时，用阻塞赋值。
(4)在同一个always块中建立时序和组合逻辑电路时，用阻塞赋值。
(5)在同一个always块中不要既用非阻塞赋值又用阻塞赋值
(6)不要在一个以上的always中为同一个变量赋值
(7)用$strobe系统任务来显示用非阻塞赋值的变量值
(8)在赋值时不要使用#0延迟
Verilog模块编程要点
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转载自blog.csdn.net/qq_41982581/article/details/82939963
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