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Makefile中的变量
此处的变量不是C/C++，Java等中的变量（认为他是一个字符串就阔以了）
一般变量名用大写字母来写，如下所属：
SUBDIR = src xml
SUBDIR += osapi
(感觉这个和Qt里面的pro加模块的差不多)
echo命令，这条命令和php中的echo差不多
定义一个SUBDIR变量：
1.用=号定义一个变量，并且赋值（等号两侧可以加一个空格）；
2.用+=追加字符串
3.用$(SUBDIR)取得到变量的值（要加小括号）
如下面的Makefile代码：
#this is an annotation
SUBDIR=src xml
SUBDIR+=osapi
test1:
echo $(SUBDIR)运行截图如下：
注意：在@符号后，就可以不显示命令本身，直接输出
Makefile源码如下：
#this is an annotation
SUBDIR=src xml
SUBDIR+=osapi
test1:
@echo $(SUBDIR)运行截图如下：
特殊的变量：
$@指代target
$^指代dependencies依赖项列表
$<指代依赖项列表的第一列
Makefile源码如下：
#this is an annotation
SUBDIR=src xml
SUBDIR+=osapi
test1:
@echo $(SUBDIR)
test2:
echo $@
test3: main.cpp first.cpp second.cpp
echo $^
test4: main.cpp first.cpp second.cpp
echo $<
程序运行截图如下：
Makefile中的函数
与C/C++里面的函数不一样，他是内部预定的函数
Makefile中有一些预定义的函数
$(函数名 参数列表)
函数名：Makefile内部自带的函数
参数列表：以逗号分开另，函数名和参数之间以空格分开
例如：
PWD=$(shell pwd)
CXX_SOURCE=$(wildcard ./*.cpp)
【注意：Makefile里面好像必须加shell】
如下的Makefile源码：
#this is an annotation
SUBDIR=src xml
SUBDIR+=osapi
PWD=$(shell pwd)
CXX_SOURCE=$(wildcard *.cpp)
test1:
@echo $(SUBDIR)
test2:
echo $@
test3: main.cpp first.cpp second.cpp
echo $^
test4: main.cpp first.cpp second.cpp
echo $<
test5:
@echo $(PWD)
test6:
@echo $(CXX_SOURCE)
运行截图如下：
